TI

CPU的效率

2019-07-18 15:32发布

站内问答 / TI MCU
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比如说FIFO默认的1/2满，接收中断触发，此时触发的中断是不是说接收的数据还没有全部接收完毕，只是收了4位，这样程序还要一直等待数据接收完毕。如果是这样的话，接收中断就占用了大量的程序时间，CPU的效率实在是太低了啊。
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9条回答
zhaoxqi
2019-07-19 00:55
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