C对GPIO的封装。
每组GPIO都要7个寄存器，用结构进行封装：
[mw_shl_code=c,true]typedef struct
{
  __IO uint32_t CRL;
  __IO uint32_t CRH;
  __IO uint32_t IDR;
  __IO uint32_t ODR;
  __IO uint32_t BSRR;
  __IO uint32_t BRR;
  __IO uint32_t LCKR;
} GPIO_TypeDef;
[/mw_shl_code]
7组GPIO宏定义：
[mw_shl_code=c,true]#define GPIOA               ((GPIO_TypeDef *) GPIOA_BASE)
#define GPIOB               ((GPIO_TypeDef *) GPIOB_BASE)
#define GPIOC               ((GPIO_TypeDef *) GPIOC_BASE)
#define GPIOD               ((GPIO_TypeDef *) GPIOD_BASE)
#define GPIOE               ((GPIO_TypeDef *) GPIOE_BASE)
#define GPIOF               ((GPIO_TypeDef *) GPIOF_BASE)
#define GPIOG               ((GPIO_TypeDef *) GPIOG_BASE)
[/mw_shl_code]
这样可以直接用GPIOA～GPIOG来引用这7组GPIO。
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7个寄存器的功能是关于引脚、输出速度、和模式的配置，使用结构体来定义这三个功能：
[mw_shl_code=c,true]typedef struct
{
  uint16_t GPIO_Pin;             /*!< Specifies the GPIO pins to be configured.
                                      This parameter can be any value of @ref GPIO_pins_define */

  GPIOSpeed_TypeDef GPIO_Speed;  /*!< Specifies the speed for the selected pins.
                                      This parameter can be a value of @ref GPIOSpeed_TypeDef */

  GPIOMode_TypeDef GPIO_Mode;    /*!< Specifies the operating mode for the selected pins.
                                      This parameter can be a value of @ref GPIOMode_TypeDef */
}GPIO_InitTypeDef;
[/mw_shl_code]
其中，输出速度是枚举类型：
[mw_shl_code=c,true]typedef enum
{
  GPIO_Speed_10MHz = 1,
  GPIO_Speed_2MHz,
  GPIO_Speed_50MHz
}GPIOSpeed_TypeDef;
[/mw_shl_code]
而模式也是枚举类型：
[mw_shl_code=c,true]typedef enum{ GPIO_Mode_AIN = 0x0,
  GPIO_Mode_IN_FLOATING = 0x04,
  GPIO_Mode_IPD = 0x28,
  GPIO_Mode_IPU = 0x48,
  GPIO_Mode_Out_OD = 0x14,
  GPIO_Mode_Out_PP = 0x10,
  GPIO_Mode_AF_OD = 0x1C,
  GPIO_Mode_AF_PP = 0x18
}GPIOMode_TypeDef;
[/mw_shl_code]
注意，枚举类型是整型，数值从开始第一个枚举值+1,所以可以从手册得知GPIO_Speed_2MHz的值是二进制10也就是2，而50MHz的值是二进制11就是3。模式没有类似的以此类推的值，分别指出模式值。
不过，模式值似乎和寄存器中的定义有点不一样，通过分析得知输入输出还和低两位本来是速度的配置位第0位有关，所以可能会在程序中进行分解。
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值得注意的还有关于上拉下拉输入的配置数据在寄存器里面都是10，模式枚举里面是不同的值，看来是在程序里面有区别的。
查阅参考手册和百度，手册上有关于端口位配置表在106页，上拉还是下拉输入通过PxODR寄存器来区分，当ODR相应位配置为0时代表输入是下拉，当ODR相应位配置为1是代表输入是上拉。
什么意思？ODR是输出数据寄存器，是直接的输出寄存器，把端口配置成输入还要配置ODR？确实如此。
可能是一种妥协，一种硬件妥协，既然输入用不到输出而输入又需要区分上下拉，就用ODR来嘛。这只是猜想，其实是芯片硬件设计使然，只要理解就可以了。