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DSP对异步存储器的--读时钟ARE的频率 是怎么控制的呢？

2019-07-28 19:18发布

站内问答 / TI MCU
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具体应用情况:
5509A DSP 的CE1空间外接了一个异步存储器（FIFO），由DSP提供的异步读时钟 ARE 的频率是怎么控制的呢？是主频/(建立时间+选通时间+保持时间)吗？  当然这三个时间可由相关寄存器配置。
比如主频设为144MHz，建立时间为2个CLK周期，选通时间为5个CLK周期，保持时间为1个CLK周期，那么ARE 频率=144/（2+5+1）=18MHz 吗？
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4条回答
zhangmangui
2019-07-28 23:21
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