ATMega64工作在5伏电压下能够兼容3.3V的管脚电平么?

2019-03-24 21:13发布

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ATMega64的
符号参数条件最小值典型值最大值单位
VIL 输入低电压除了 XTAL1 和RESET 引
脚-0.5 0.2 VCC
(1) V
VIL1 输入低电压XTAL1 引脚,外部时钟-0.5 0.1 VCC
(1) V
VIL2 输入低电压RESET 引脚-0.5 0.2 VCC
(1) V
VIH 输入高电压除了 XTAL1 和RESET 引
脚0.6 VCC
(2) VCC + 0.5 V
VIH1 输入高电压XTAL1 引脚,外部时钟0.7 VCC
(2) VCC + 0.5 V

我理解为3.0V为其管脚最小识别高电压,但是另一个片子是3.3V,理论上应该可以,但容限为0.3V,有点不踏实


想问问有过类似经验的确认一下 此帖出自小平头技术问答
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19条回答
蒋李
2019-03-25 17:40
DC OPERATING CHARACTERISTICS VDD = 2.7-3.6V
Symbol Parameter
Limits
Freq Min Max Units Test Conditions
IDD
1 Active VDD Current
Read 5 MHz 15 mA CE#=OE#=VIL, WE#=VIH,
1 MHz 10 mA All I/Os open
Program and Erase 40 mA CE#=WE#=VIL, OE#=VIH
ISB Standby VDD Current 20 μA CE#, RST#=VDD±0.3V
IALP Auto Low Power VDD Current 20 μA CE#=0.1V, VDD=VDD Max
WE#=VDD-0.1V
Address inputs=0.1V or VDD-0.1V
IRT Reset VDD Current 20 μA RST#=GND
ILI Input Leakage Current 1 μA VIN =GND to VDD, VDD=VDD Max
ILIW Input Leakage Current
on WP# pin and RST# pin
10 μA WP#=GND to VDD, VDD=VDD Max
RST#=GND to VDD, VDD=VDD Max
ILO Output Leakage Current 1 μA VOUT =GND to VDD, VDD=VDD Max
VIL Input Low Voltage 0.8 V VDD=VDD Min
VILC Input Low Voltage (CMOS) 0.3 V VDD=VDD Max
VIH Input High Voltage 0.7 VDD V VDD=VDD Max
VIHC Input High Voltage (CMOS) VDD-0.3 V VDD=VDD Max
VOL Output Low Voltage 0.2 V IOL=100 μA, VDD=VDD Min
VOH Output High Voltage VDD-0.2 V IOH=-100 μA, VDD=VDD Min

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