TMS320F2812在引脚SPISIMO上将数据输出，与之相对应的是TLC5620I的DATA数据接收引脚：TMS320F2812的SPICLK引脚和TLC5620I的CLK引脚相对应，二者共用串行时钟；TMS320F2812的IOPB1模拟控制TLC5620I的LOAD引脚电平，以锁存数据，更新输出电压。在数据传输时，有两种方式控制TLC5620I输出电压的更新：LOAD引脚控制更新和LDAC引脚控制更新。该设计采用LOAD引脚控制更新方式，此时，LDAC引脚接低电平。开始控制LOAD为高电平，数据在CLK引脚的每一个下降沿与时钟同步从DATA引脚输入。当所有的数据传输完毕时，控制LDAD引脚跳至低电平，所选择的D／A通道的输出电压得到更新。由于TLC5620I的控制信号要求的VIH较高，所以需要将DSP输出的SPI-CLK、SPISIMO以及I／O口模拟的CS信号的高电平提高，该设计采用MM74HC08器件来实现。