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关于PAL输出显示的问题
2019-03-25 07:35
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FPGA
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对于50Hz的模拟视频经过模数转换进入FPGA,加上一些算法后控制输出,现在由于某些原因我没办法保证我的输入视频是严格的20ms一个周期,但是这个误差不是很大,肯定不会影响最后PAL输出的有效数据,只是会影响消隐信号的长度,现在有什么办法能让它显示的效果好一点吗? 现在的现象是如果差的稍微大一点图像就会有一些抖动。
不知道我的描述清不清楚。。谢谢
此帖出自
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7条回答
dontium
2019-03-25 14:58
“50Hz的模拟视频”,按标准的,它应该有同步信号,把同频信号提取后使用,这样可不用保证“严格的20ms”
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