关于PAL输出显示的问题

2019-03-25 07:35发布

对于50Hz的模拟视频经过模数转换进入FPGA,加上一些算法后控制输出,现在由于某些原因我没办法保证我的输入视频是严格的20ms一个周期,但是这个误差不是很大,肯定不会影响最后PAL输出的有效数据,只是会影响消隐信号的长度,现在有什么办法能让它显示的效果好一点吗?  现在的现象是如果差的稍微大一点图像就会有一些抖动。





不知道我的描述清不清楚。。谢谢
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7条回答
chunyang
2019-03-26 05:32
3008202060 发表于 2015-6-28 20:55
关键是我生成的行场同步信号是和上一级的外同步有一个固定的关系,因为我是FPGA生成的信号,信号质量有保 ...

既然有数字化的过程,那么信号应该全部重新生成,跟前级信号已无关,否则要FPGA介入有何意义?

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