如何修正时序约束中slack为负的问题

2019-03-25 07:59发布

站内问答 / FPGA
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我已经在sdc文件中做了约束了create_clock -name {iclk_27M} -period 37.000 -waveform { 0.000 18.500 } [get_ports {iclk_27M}]但是它的slack还是负的 这个应该咋解决啊
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2条回答
coyoo
2019-03-25 17:52
< / 具体路径具体分析，看看是否有false path或跨时钟域路径

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