Xilinx ISE环境下Verilog HDL编程实现UART接口的设计

2019-03-25 08:10发布

站内问答 / FPGA
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求一份UART接口ip软核设计源码，在线等！ 此帖出自小平头技术问答
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2条回答
kdy
2019-03-25 18:33
请看下espier专区里的sdram那个帖子里面有uart

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