C语言多层循环怎样转换为verilog语言使FPGA最省时间

2019-03-25 08:11发布

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遇到一个需要将一段C代码转换为verilog语言，同时需要FPGA处理最省时间，请问各位高手怎样处理比较好呢，小弟是新手请多多指教，谢谢。
for(int i =0;i<100;i++)
{
    int num = m;//m是一个变量，取值不确定。
    for(int j=0;j<num;j++)
    {
          int ipword = assigned[i*m+j];//assigned为一个前面定义的数组，成员值不确定。
          int tmpvalid = pfile[ipword];//
          for(int k=0;k<tmpvalid;k++)
          {
              float tmpscore = signatureset[i*m+j] ^ pinvert[ipword][k];//数据处理。
          }
    }
}
此帖出自小平头技术问答
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5条回答
白丁
2019-03-26 05:34
并不是所有的东西在FPGA上都能够并行实现，这要看数据的相关性

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