状态机触发事件采样,会出现亚稳态吗

2019-03-25 08:20发布

状态机中,触发事件XRD下降沿触发时,按照clk触发时,信号需要建立时间和保持时间,条件语句if(!XRD)能正确采到XRD=0吗

always  @(posedge clk or negedge rst_n)
begin
    if(!rst_n) cstate<=idle;
    else cstate<=nstate;
end

always@(cstate or XRD or ........)
begin
  case(nstate)
    idle:
    if(!XRD) nstate<=d1;
    else nstate<=idle;
    d1:.........

end 此帖出自小平头技术问答
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2条回答
1559638992
2019-03-25 09:41
XRD是跨时钟域,输入信号。寄存器打两拍是为了在时序逻辑中使用,即在always@(posedge clk or negedge rst_n)中使用,但我没有在时序逻辑中使用,在always@(cstate or XRD or ........)
使用,直接用的输入信号触发

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