CPLD 产生脉宽可调PWM信号

2019-03-25 08:40发布

站内问答 / FPGA
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各位大神，我用altera公司的EPM240做了一个pwm输出，项目要求：脉宽为10ns~100ns可调，幅值为3.3，频率为100k，脉冲信号的上升时间小于5ns。但是我做出来的上升时间都快50ns了，但是技术工程师说IO的响应时间为ps级别，我的为什么实现不了，请大家帮忙指导！ 此帖出自小平头技术问答
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14条回答
dongxu_LCC
2019-03-27 01:58
谢谢，老板只要求用aitera的CPLD，那我就 买快MAX V试试吧！

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