VHDL语言语法的思路。

2019-03-25 08:50发布

站内问答 / FPGA
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小弟是新手，想请教大家一个问题。
我想用VHDL语言在一个时钟周期内，一个IO口输出8位数据，该如何编写呢？有什么思路？ 此帖出自小平头技术问答
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1条回答
eeleader
2019-03-25 15:33
< / 你这个一个时钟周期是多长，是FPGA的系统时钟周期吗啊？

如果是，那是无能为力的

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