FPGA的输入数据和输入时钟不同步

2019-03-25 08:54发布

站内问答 / FPGA
8028 5 1742
AD芯片输出数据和时钟到FPGA，本来是同步的，但数据又通过了差分转单端芯片，导致数据和时钟不同步，在FPGA采到的数据出现毛刺，这种情况怎么解决？如何把数据和时钟做到同步，再在FPGA内进行跨时钟域的同步设计！ 此帖出自小平头技术问答
友情提示: 此问题已得到解决，问题已经关闭,关闭后问题禁止继续编辑，回答。
5条回答
fuyaolong
2019-03-25 18:19
输入的数据和时钟的相位关系都不确定，怎么往RAM里写，能保证写进去的数据的正确性吗？靠谱吗

一周热门 更多>

相关问题