Cyclone3 I/O逻辑电平兼容问题

2019-03-25 09:06发布

站内问答 / FPGA
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我把FPGA的3、4、5、6bank用于与DDR1接口相连接。DDR的I/O电压是2.5V，可是FPGA的这几个bank的VCCIO我却都连到3.3V上了。这对后续的电路设计会造成什么影响呢？在判决DDR传输过来的0/1数据时会出错么？我好像有看到说cyclone3的IO口是2.5V和3.3V兼容的，是什么意思呢？对于我现在这个问题有帮助吗？急急急！
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2条回答
eeleader
2019-03-25 12:42
这个问题应该看看FPGA手册和SDRAM手册，研究一下3.3V IO的高电平与低电平电压范围；以及2.5V IO接口高电平与低电平电压范围。
看看二者是否匹配。

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