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关于CPLD的问题。
2019-03-25 09:07
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FPGA
3753
7
1602
VHDL程序是对的,顶层原理图也没有问题,当我把顶层模块的device改成适合实验箱的型号时,再compiter检查时,会提示protect doesn't fit.是什么原因啊?(我用的是Max+plus 2). 此帖出自
小平头技术问答
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7条回答
993874007
2019-03-25 23:09
查查CPLD内部资源是否够用,再看看引脚是否正确配置
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