SDRAM控制器问题，请帮助

2019-03-25 09:31发布

站内问答 / FPGA
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我用华清的程序（实战训练13 SDRAM读写控制的实现与Modelsim仿真），为什么一次写和读总是160*16   用的是mt48lc8m16a2  16位的，  （列*行）是4096*512，  貌似用的是全页突发，但也应该是一次读写512个单位啊！关键程序如下 control_interface： if (LOAD_REG1 == 1)                 begin                         SC_CL   <= SADDR[1:0];                   // CAS Latency                         SC_RC   <= SADDR[3:2];                   // RC delay                         SC_RRD  <= SADDR[7:4];                   // RRD delay                         SC_PM   <= SADDR[8];                     // Page Mode                         SC_BL   <= SADDR[12:9];                  // Burst length                 End   Sdram_top:   always @ (STATE or w_page or r_page )//STATE or w_page or r_page or r_ba or w_ba case(STATE)     PRECHARGE:  addr = 'h1f0000;     LOAD_MR:    addr = 'h37;     LOAD_R2:    addr = 'h5F6;     LOAD_R1:    addr = 'h82f; //'h10f;     PAGE_WRITE: addr = {2'b0,w_page,8'b0000_1111};//PAGE_WRITE     PAGE_READ:  addr = {2'b0,r_page,8'b0000_1111};//8'b0000_1111是列地址     BT_W:       addr = {2'b0,12'b0,8'b0000_1111};        CLOSE_PAGE_W:   addr = {2'b0,12'b0,8'b0000_1111};     CLOSE_PAGE_R:   addr = {2'b0,12'b0,8'b0000_1111};     BT:     addr = {2'b0,12'b0,8'b0000_1111};     default:    addr = 'h0;   谢谢 此帖出自小平头技术问答
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1条回答
eeleader
2019-03-25 13:38
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