请教ALTERA DDR控制器local_rdata_valid信号的问题

2019-03-25 09:46发布

站内问答 / FPGA
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用stratix II控制DDR2的读写。在使用中发现local_rdata_valid信号很奇怪，signalTap抓出来的读写数据都对，就是local_rdata_valid信号不出来，偶尔重新编译下载后能出现，有时候同一个SOF文件下载下去local_rdata_valid信号也是有时成功输出有时没有。
请问使用过DDR 控制器的大侠指点一下！ 此帖出自小平头技术问答
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2条回答
wucaidai
2019-03-25 19:17
换一种加载方式pof试一试，看看有没有改善；
如果没有那肯定说明你的时序有问题，设计有问题。

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