求助不可综合语句使用问题？

2019-03-25 09:46发布

站内问答 / FPGA
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        本人新手，在学习verilog语言的不可综合语句时候不知道编写的测试程序怎样在quartus II中查看测试结果。如：$display ,$monitor都不知道输出在哪里啊？      如果哪位有相应资料或不吝赐教本人不胜感激啊！谢谢啦啊！ 此帖出自小平头技术问答
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2条回答
eeleader
2019-03-25 12:39
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$display ,$monitor都不知道输出在哪里啊？

这些都是仿真语句啊！

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