异步时域数据处理

2019-03-25 09:46发布

站内问答 / FPGA
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我用cpld做了两块板子，一块AD ，串并转换发射数据，一块接收数据。但接收数据总是有点不准确，后来发现原因是时钟不同步，但是没办法把两块板子用同一个时钟源，两块板子上的晶振都是75M，数据的速率是12.5M 用接收的板子去读发射的数据有点不正确，后来做了乒乓操作也没有效果，大家有什么比较好的办法吗？ 此帖出自小平头技术问答
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5条回答
gaosjp
2019-03-26 00:51
不好意思是我没有说清楚，这个芯片要给其一个参考时钟，是我本地分频出的12.5M的时钟，然后里面有CDR模块会恢复出一个12.5M的时钟 以恢复出的12.5M上升沿读取数据，但我要对几个12.5M的数据进行时分复用。

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