求助如何测试sdram控制器

2019-03-25 10:06发布

站内问答 / FPGA
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大家好.本人正在学习verilog,手上Altera的开发板上有一块sdram,
所以想写一个sdram控制器.请问大家我写完之后在modelsim里如何去写
testbench?以前听说ddr在ise里能够调用仿真模型和配套的testbench模板,
那么quartus有这样的功能吗,请前辈们指点一下我该如何去测试,谢谢了! 此帖出自小平头技术问答
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2条回答
lidywk
2019-03-25 16:31
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