STM32

同样的主频，低晶振高倍频还是高晶振低倍频？

2020-01-01 17:45发布

站内问答 / STM32/STM8
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本帖最后由 金 {MOD}大元宝 于 2017-1-3 12:53 编辑

以STM32F407为例，如果我要配置主频168M，，

两种配置方式，一种晶振8M，PLL倍频21。

另外一种是晶振24M，PLL倍频7。

那种主频的稳定性更好？


25M配置

  1. *-----------------------------------------------------------------------------
  2.   *        HSE Frequency(Hz)                      | 25000000
  3.   *-----------------------------------------------------------------------------
  4.   *        PLL_M                                  | 25
  5.   *-----------------------------------------------------------------------------
  6.   *        PLL_N                                  | 336
  7.   *-----------------------------------------------------------------------------
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8M配置

  1. *-----------------------------------------------------------------------------
  2.   *        HSE Frequency(Hz)                      | 8000000
  3.   *-----------------------------------------------------------------------------
  4.   *        PLL_M                                  | 8
  5.   *-----------------------------------------------------------------------------
  6.   *        PLL_N                                  | 336
  7.   *-----------------------------------------------------------------------------
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18条回答
wye11083
2020-01-02 12:46
mangocity 发表于 2017-1-3 12:49
PLL 只跟踪相位误差，不能消除频率误差。
假设 PLL 的传递函数为 G(s)
有 Fout = Fin * G(s)

pll有一个输入带宽，在带宽内的误差会被滤波掉（即pll的vco接近中心频率）。但是vco电压毕竟也是dac控制的，因此pll通常都有几十至数百ps的jitter，就是这么引起的。超高精度的pll估计dac位数也很高，而且必须要有很强的算法去跟踪频率，否则来个100ppm的抖动就可能丢失信号了。
不过一般还好，时钟源一般是比较稳定的，pll可以正常跟踪。
至于pll相位，我也不太明白它的工作原理，但是分析它有可能使用n/N的分压，用上升沿和下降沿控制后面输出。像xilinx应该只有16个相位，altera据说可以到1/256T。

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