2020-02-02 10:02发布
liguangyu678 发表于 2019-4-19 09:00 直接连FPGA的PIN脚啊 nios是使用的FPGA的内部资源 类似IP核的使用而已
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看来我的表述还是有问题，譬如pll的clock输出与nios的clock输入可以直接通过连线相连接，然后我用verliog写了一个脉冲计数的模块，得到了一组数据AD[15:0]，我就想怎么把这组数据送到nios里面去处理，这些都是在altera芯片内部交换，并不涉及到片子的管脚
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