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virtex5 DDR2调试求教
2020-02-03 10:38
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FPGA
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本帖最后由 jiangwenj02 于 2016-10-11 12:26 编辑
最近在做VIRTEX5的DDR2 MIG 调试,phy_init_done管脚一直没有拉起来(仿真可以拉起来),error也没有拉高,原因找不到~求问都有什么办法找原因?硬件上的原因应该不太可能,是照着一个通过验证的板子设计的。DDR2的电路图在附件里边
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5条回答
zyingjie
2020-02-03 16:56
这么点东西有啥好遮遮掩掩的
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