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2020-02-04 10:32
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FPGA
17981
7
7
数据收发采用串行传输协议,串行数据位宽1bit。数据采用双沿传输,上升传输奇数位、下降沿传输偶数位。系统时钟提供的是160MHz,数据收发采用的时钟速率是40MHz。为减少功耗及降低干扰,时钟不是持续输出,有参数要传输时发送时钟和数据,没有数据时,时钟和数据都为低。求大神帮忙
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7条回答
Chaos_zc
2020-02-04 15:56
为什么不自己写
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