FPGA

编译是出现的问题？

2020-02-06 11:19发布

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编译是出现的问题，帮忙看一看，改了几遍都不知道出错在哪？谢谢？

Error (10170): Verilog HDL syntax error at Verilog1.v(12) near text "always";  expecting "@", or an identifier ("always" is a reserved keyword )
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7条回答
3008202060
2020-02-07 07:56
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