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CycloneIV控制DDR2的最大时钟频率是多少？

2020-02-06 11:41发布

站内问答 / FPGA
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用的FPGA是CycloneIV,速度等级-6，手册上只写了最大时钟频率是200Mhz,DDR2的控制引脚分配在bank3和bank4。实际应用的时候这个时钟能跑到多快呀？
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6条回答
汉水之子
2020-02-06 17:06
可以在手册中DDR相关部分找到具体要求的

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