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FPGA
FPGA画面拼接方案
2020-02-06 11:42
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FPGA
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现有一个项目,需要把4路VGA信号,每一路1920*1080,拼接成一路4K@60Hz超高清信号3840*2160输出。
这种情况需要用哪种级别的FPGA能够实现,大家给个建议。需要用到哪些资源?
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13条回答
zhongxon
2020-02-07 07:02
双通道的DDR3,没有任何地址线和数据线和控制线共用。两个通信完全独立。
对于FPGA内部,软件部分,会对两个DDR3控制器统一编址。
对于用户逻辑部分,各自使用各自的DMA实现数据读写。
DDR3-1600,指的是时钟是800MHz,由于是双沿读写数据,所以数据率是1600.
实际我在-2的K7上做到了DDR3-1800,时钟是900MHZ,也很稳定 ,Xilinx的FPGA真不是吹的。:)
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对于FPGA内部,软件部分,会对两个DDR3控制器统一编址。
对于用户逻辑部分,各自使用各自的DMA实现数据读写。
DDR3-1600,指的是时钟是800MHz,由于是双沿读写数据,所以数据率是1600.
实际我在-2的K7上做到了DDR3-1800,时钟是900MHZ,也很稳定 ,Xilinx的FPGA真不是吹的。:)
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