2020-02-17 19:58发布
jlrhw 发表于 2015-1-30 15:03 管脚都和原理图对应一一做了约束 当引脚输出设置低电平的时候灯亮，我在顶层模块的这里 always @ (posedg ...
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量一下时钟有没有。
或者你试试 always里面用异步复位不要用同步。
用同步的话如果你时钟没有输入那灯就不会亮。
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