FPGA

Verilog 语句执行顺序

2020-02-23 10:48发布

站内问答 / FPGA
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在Verilog模块中分两部分：1.声明部分，比如端口定义，寄存器定义；2.功能实现部分，如加减乘除等等操作。小弟菜鸟，想请问高手：这两部分是不是必须先执行声明部分后才能执行功能部分？？？
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7条回答
yqhc1216
2020-02-23 20:39
不声明 执行语句必然报错啊

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