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FPGA测试光电编码器转速--高低电平不均匀问题

2020-02-27 21:09发布

站内问答 / FPGA
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用FPGA测试光电编码器转速时，编码器的测试效果用signaltap显示出来了，现在有个问题是，A，B的高低电平持续时间不均匀，可能是什么原因啊？ 求指教……
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10条回答
lbqq2006013
2020-02-28 08:14
huangxz 发表于 2013-10-7 22:13
还是用示波器实际看看AB的波形,如果AB很均匀，那有可能是你的采样频率不够 ...

恩   我试过提高采样频率，抓取的图形肉眼看不出区别，但是实际测量还是偶尔会有小格的区别… 具体原因还没弄明白……

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