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FPGA
关于等精度测频测不到1Hz以下的问题
2020-02-27 21:18
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FPGA
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由于采用1s计数,1Hz以下的信号在闸门信号内没有高电平,所以就测不到,
如果采用10s钟计数的话又太慢了,应该怎么弄才好?
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11条回答
shiyinjita
2020-02-29 01:25
lynn2013 发表于 2013-8-24 11:12
高频测低频是怎么弄的,和等精度有什么区别呢
低频的上升沿或者下降沿作为使能端,计数就可以了。当第二个上升沿来的时候,同时把这次的计数值放在一个寄存器里
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