FPGA

modelsim仿真只有输入没有输出波形

2019-07-15 20:38发布

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初学者仿真altera一个很简单的分频，不知道为啥只有输入波形没有输出的波形，fout输出信号就是一条红线，求指点~~tb文件和原文件如下
`timescale 1 ns/ 1 ns
module div4_vlg_tst();
reg fin;                                            
wire fout;                    
div4 i1 (
.fin(fin),
.fout(fout)
);
initial                                                
begin                                                  
#0 fin = 1b'0;                  
end                                                   
always  #5  
begin                                                  
fin <= ~fin;
end                                                  
endmodule


原始文件
module div4(fin,fout );
input        fin;        
output        fout;
reg       fout;        
reg        [1:0]q ;
always @(posedge fin)
begin
       if(q==1)
     begin
       q<=0;
              fout =~fout ;
     end
       else
      q<=q+1;
end
endmodule
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6条回答
bertvwang
2019-07-16 00:34
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