FPGA

Xilinx 在ISE已完成的工程文件中添加IP核

2019-07-15 21:08发布

站内问答 / FPGA
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已经有一个现成的AD采样模块，现在想添加功能，所以想在源工程中添加一个后续处理IP核，添加之后不知如何处理。
截图00.jpg
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6条回答
fudadaqaz987
2019-07-16 05:31
谢谢

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