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如何理解Xilinx的RTL图
2019-07-15 21:29
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FPGA
4760
9
1350
各位大神，我的通用移位寄存器HDL代码如上，我用的Xilinx ISE开发环境，我想问综合后的RTL图要如何理解，上述HDL代码的RTL图如下所示，
请问图中那些未连接的pin都是什么情况？该图要如何与HDL代码联系起来？
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9条回答
rainy332616759
2019-07-16 22:04
小三角形是因为是这根线左右的数据位数不等
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