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FPGA
求助CPLD逻辑复制出现的问题
2019-07-15 22:26
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FPGA
5984
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各位大神,我在用CPLD同时驱动三块相同的CCD,驱动信号相同,所以我将同一个模块例化三次,但其中有一个2M的方波信号,在前两个模块例化后,输出正常,但是第三个模块例化后的输出是一个脉冲波,频率依旧是2M,经测试,最多只能例化两次。CPLD型号是EPM570T100C5, 时钟50MHz,异步复位,RTL视图和波形示意图如下所示:
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此问题已得到解决,问题已经关闭,关闭后问题禁止继续编辑,回答。
2条回答
佳
2019-07-15 23:05
既然三组信号一样,为啥不直接在一个模块中输出三个一样的信号呢
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