FPGA

quartus中原理图的数组输出怎么接pin？

2019-07-15 22:48发布

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如图，我给怎么给sent[5:0]到output连线啊？

原理图数组输出.png
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4条回答
正在路上的
2019-07-16 05:54
已解决！
只需要一个output，设为set_out[7..0]即可了。。。。。。
开始改成【7:0】，结果还是错误！

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