2019-07-15 23:36发布
香脆面 发表于 2015-8-24 14:01 遇到过类似的问题，代码编译没问题，但modelsim启动仿真的时候会报错，说Error loading design。一般都是一些内部信号定义不一致之类的问题。比如设计中有两个子模块A和B，A给B传递一个信号，但是A的输出端口和B的输入端口中，这个信号的类型、位宽等定义的不一致。这样的代码在编译时是检查不到语法错误的，在启动仿真时才 ...
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是这样的，所用的工程以前是可以仿真的，而且没出问题，也不存在你说的那种问题
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