怎么解决EDK中RDPFIFO溢出的问题！-164908060的回答

怎么解决EDK中RDPFIFO溢出的问题！

2019-07-16 00:40发布

本帖最后由 machairodus 于 2014-5-29 00:10 编辑

小弟我最近用EDK做一个视频采集系统，做了一个视频采集的IP核，希望将采集
到的视频数据传到DDR2 中缓存。制作ip核时，我在IPIF界面选择使用rdpfifo，目的是
在userlogic中，将有效数据写入此fifo，然后在控制C程序中，使用生成的驱动函数：
PALIN_mReadFromFIFO(XPAR_PALIN_0_BASEADDR,0)来将数据写入DDR2中。下图
就是利用中断从FIFO中读取数据写入DDR的过程。
读fifo.jpg

然后问题就出现了，我发现写入DDR2中的数据只有前2048个是正确的，后面的都
不对，而2048正好是我设定的FIFO深度，所以问题应该是FIFO溢出了，我是这样理解的：
PALIN_mReadFromFIFO（）这个函数虽然读出了fifo中的数据，但是并没有释放fifo的
空间，导致只能正确写入2048个数据，不知道我的理解对不对。

究竟要如何做才能保证fifo释放了呢？在userlogic中，关于此FIFO只给了下图中几个信号，

其中能操作的也就output那几个，而IP2FIFO_Release、IP2FIFO_Restore和IP2FIFO_WrMark
这三个信号是用于packet的，这里没用到也不管，那么就只剩下IP2FIFO_WrReq和IP2FIFO_Data
了，但是这两个信号是用来往fifo里写数据的。在这里似乎也不能释放fifo?

总结一下吧：问题中的fifo是在edk生成ip核时的ipif界面生成的，它的作用是将IP核的数据通过microblaze写入DDR，所以写入fifo这部分功能应该是在IP中实现（也就是userlogic中），而读取fifo则应该是通过c程序（生成的驱动函数）实现。实际上，在ip核的userlogic中，只给了写fifo的控制信号，并没有给出读fifo的控制信号。如果是纯硬件语言控制的fifo，读出fifo中的数据后fifo也就同时释放了相应的长度；而现在使用驱动函数读取fifo，虽然能读到数据，但是却没能释放fifo，导致只能正确执行fifo深度（2048）的读写操作。