CPLD和VERILOG语言之间怎么协同工作的

2019-07-16 01:15发布

本人初学CPLD/FPGA,现有一疑问:用verilog写的一个项目的程序,读起来类似于C语言那种一条一条执行的指令,这程序烧到CPLD芯片里后是怎么工作的,芯片会自己搭一个门电路出来吗?
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