本帖最后由 火柴棍儿 于 2013-4-4 20:14 编辑
这是我第一次写testbench文件,实现1和9的相加。用modelsim
仿真编译时有错误。请各位大侠帮忙。module文件和testbench文件都在压缩包里,小弟十分感谢。现将代码附上(貌似在压缩包里的下载要E币啊):
module文件代码:
module fulladd4(
sum,
cout,
ina,
inb,
cin);
output [3:0] sum;
output cout;
input [3:0] ina,inb;
input cin;
assign {cout,sum}=ina+inb+cin;
endmodule
Testbench代码:
module fulladd4_tb;
reg [3:0] a,b;
reg cin;
wire [3:0] sum;
wire cout;
fulladd4_dut (
.sum (sum ),
.cout (cout),
.ina (ina ),
.inb (inb ),
.cin (cin )
);
ini
tial
begin
a=4'b1;
b=4'b9;
cin=1'b1;
end
endmodule
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-
fulladd4.zip
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