FPGA

编译简单语句出错求助

2019-07-16 02:09发布

站内问答 / FPGA
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module adsadsddf(rw, co_data,in_data,out_data);
input rw;
input[3:0] co_data ;
output[3:0] in_data;
input[3:0] out_data;
assign in_data=co_data;
assign co_data=(rw==1b'1)? 4'bz:out_data;
endmodule



编译时系统说倒数第二条语句错，就是assign co_data=(rw==1b'1)? 4'bz:out_data;出错，怎么回事，急求帮助
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2条回答
lstcspring
2019-07-16 04:42
”input[3:0] co_data “
“co_data=(rw==1b'1)? 4'bz:out_data;”输入型的赋值，不能这样用

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