tica, Arial, sans-serif">本项目使用的是cycloneIII的芯片，利用IP核生成了一个DDR2的控制器，但是再分配引脚的时候产生了如下问题，如
Error: The assigned location PIN U21 for DQ pin "mem_dq[0]" is not a legal location
Info: There is no legal DQ location that supports 9 DQ pins
此时才知道，利用ip核时候，输出引脚是需要分配到特定的引脚上面的，，，，
这个倒是没有什么，对于仿真的人员而言，是可以修改的，但是我的程序是跑在自己设计的板子上面的，而且已经制作成功，所以修改引脚分配是木有用的，这才是欲哭无泪的地方啊!!!!
针对于这种情况，有没有其他解决方案，而不是从新设计硬件PCB板的，求助！！！！！
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法一：自己重新设计一个DDR控制器，这个比较难，而且时间不允许，放弃；如果走运的话，可以在网上找到别人贡献的DDR控制器，做一下修改可以的。根据本人经验，这个对于altera系列的来说，还真是少，有strrixt系列，但是cyclone系列那就比较悲剧了，大部分都是Xilinx的。全凭个人人品啦
法二：重新设计PCB，这个是没有办法的，建议先配置DDR控制器，这样就可以根据FPGA来调整PCB，并且回想调整直到满意为止。
遗留问题：altera的IP核位宽只能设置为4，这个比较头疼，效率太低了，唉，，，，
经验教训：下次做这种IP核的时候，一定要完全软件配置完成，包括引脚配置，这样可以降低成本！减少弯路
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