想写个16位计数器,
仿真没结果,是不是哪里逻辑错了
- module counter_16(input clk,input clr ,output reg[15:0] outda
- );
- reg[7:0] count;
- always@(posedge clk)
- begin
- if(clr) outda<=4'h0;
- else
- begin
- if(count<100) count<=count+1;
- else
- if(count>=100)begin
- outda<=outda+1;
-
- count<=0;
- end
- end
-
- end
- endmodule
复制代码
友情提示: 此问题已得到解决,问题已经关闭,关闭后问题禁止继续编辑,回答。
一周热门 更多>