16位计数器仿真没结果,求助?

2019-07-16 02:22发布

想写个16位计数器,仿真没结果,是不是哪里逻辑错了


  1. module counter_16(input clk,input clr ,output reg[15:0] outda
  2.     );
  3.     reg[7:0] count;
  4.   always@(posedge clk)
  5.     begin
  6.    if(clr) outda<=4'h0;
  7.    else
  8.     begin
  9.       if(count<100) count<=count+1;
  10.       else
  11.         if(count>=100)begin
  12.      outda<=outda+1;
  13.    
  14.    count<=0;
  15.    end
  16. end
  17.          
  18. end
  19. endmodule
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