FPGA

请问$display ("i=%0d(%b binary)",i,i);这句是什么意思？

2019-07-16 02:24发布

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  module for_loop;
  integer i;
  initial
  for (i=0;i<4;i=i+1) begin
  $display ("i=%0d(%b binary)",i,i);
  end
  endmodule
请问$display ("i=%0d(%b binary)",i,i);这句是什么意思？
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2条回答
panhaojie
2019-07-16 07:22
diangongshi 发表于 2011-11-19 22:05
你好, 能说下你用的是什么语言吗? 看样子是后面的两个 i 替换掉%0d 和 %b,
...

版主，我用的是verilog HDL语言

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