FPGA

求助，急

2019-07-16 02:28发布

站内问答 / FPGA
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Verilog语言代码
1,4,15 位二进制加减法器代码，
谢谢，急用:)
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1条回答
applezen
2019-07-16 03:29
module adder(a,b,sum,cin,co);
        input[3:0]        a,b;                //input a,b;//input[14:0] a,b;
        input cin;
        output[3:0] sum;                //output sum;//output[14:0] sum;
        output co;
        assign {co,sum}=a+b+ci;
endmodule
//
module subber(a,b,sub,cin,co);
        input[3:0]        a,b;                //input a,b;//input[14:0] a,b;
        input cin;
        output[3:0] sum;                //output sum;//output[14:0] sum;
        output co;
        assign {co,sum}=a-b-ci;
endmodule

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