电路设计

关于mos隔离后上升沿问题

2019-07-16 12:12发布

站内问答 / 电路设计
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我在设计电路时，从FPGA出来的方波波形是很好的，上升沿也是垂直上升的，但经过mos隔离后，上升沿时间变长不在垂直上升。现在想办法需要减少上升沿时间，我的解决方法是将d级上的上拉电阻减小，但在这里想问大家有没有更好的方法
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11条回答
月痕霜
2019-07-16 20:50
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