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电路设计
请问40M晶振输出异常可能有哪些原因?有源晶振
2019-07-16 16:17
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站内问答
/
电路设计
10469
6
1010
本帖最后由 mouxiang 于 2016-1-13 17:36 编辑
如下图所示,
40M
晶振输出异常:
1
测量条件是,晶振输出通过
0
欧电阻与
FPGA
时钟输入连接。
其输出波形如下:
如果将示波器从直流改为交流测量,如下图:
下图为
3.3V
供电的波形:
2
测量条件是,去掉晶振输出脚到
FPGA
时钟输入间的电阻
R125
,即晶振输出脚悬空。
其输出波形如下:
如果将示波器从直流改为交流测量,如下图:
3.3V
输入电压的波形如下图:
3
我用一块正常的其他板子测试,板上也有
40M
晶振,且晶振部分
电路
相同。无论输出是否接负载,均得到下图,示波器频率读数为
40M
:
以上是我测试时的一些现象。想请教各位朋友一下是否有遇到过类似的问题。
先谢过了!
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6条回答
mouxiang
2019-07-16 22:04
简单地说,就是一个40M晶振电路原封不动的从一块板子挪到另一块板子上来用的时候出现了问题,原来可以输出40MHz信号的,现在却只能输出一个直流量上面叠加几百毫伏的交流量。实在是不知道原因啊~~~
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