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在理想运放中，运放的特性不会随电源电压的变化而变化。当然，分析理想运放时，我们使用的电源，也会被假设成理想电源。但实际情况并非如此，实际的运放，电源电压发生变化时，总会引起运放参数的变化。这就引出运放的一个重要参数，运放的电源抑制比PSRR。维基百科中给出了PSRR的详细定义，就是当运放的电源电压发生变化时，会引起运放的输入失调电压的变化，（又是失调电压），这两个变化的比就是运放的PSRR。如下式
通常用dB表示。PSRR = 20log(⊿Vcc/⊿Vios)。有些数据手册中，也会通过失调电压对电源变化的比来表示。单位一般用uV/V。如下图，是OPA365的datasheet中的表示，这个也不难理解。我们不用为找不到上式定义的比率dB值，而感动伤心。这两种表示方法，都可以让我们清楚的理解到运放对电源电压变化的抑制能力。
PSSR为有限值的原因，也是来源于运放差分输入管的不完全匹配。下面着重讨论它的影响。如下图是对OPA376运放的一个计算实例。当电源电压变化500mV时，就会引起输入失调电压10uV的变化，如果放大倍数为2，刚输出端变会产生20uV的变化。一些电路放大的倍数更大，则输出失调电压变更大。这足以使一个输送给16bitsADC的信号产生误差。（16位ADC的一个LSB对应的变化为15ppm
of FSR）。
通常用dB表示。PSRR = 20log(⊿Vcc/⊿Vios)。有些数据手册中，也会通过失调电压对电源变化的比来表示。单位一般用uV/V。如下图，是OPA365的datasheet中的表示，这个也不难理解。我们不用为找不到上式定义的比率dB值，而感动伤心。这两种表示方法，都可以让我们清楚的理解到运放对电源电压变化的抑制能力。
PSSR为有限值的原因，也是来源于运放差分输入管的不完全匹配。下面着重讨论它的影响。如下图是对OPA376运放的一个计算实例。当电源电压变化500mV时，就会引起输入失调电压10uV的变化，如果放大倍数为2，刚输出端变会产生20uV的变化。一些电路放大的倍数更大，则输出失调电压变更大。这足以使一个输送给16bitsADC的信号产生误差。（16位ADC的一个LSB对应的变化为15ppm
of FSR）。
