FPGA - 平头弟

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刚学Verilog，编了下面的程序，仿真时运行出不来结果

JasonnLee 2020-02-02 11:09

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初学Verilog，出现的错误解决不了，求帮忙

夏天的微笑 2020-02-02 11:09

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哪位大神帮忙看一下Verilog程序，是哪里的问题

Ericsson11 2020-02-02 11:08

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同段代码在 test bench和在工程模块中结果不一样

pingis58 2020-02-02 11:08

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请教Verilog中case书写用法

s_h_q 2020-02-02 11:08

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语法错误A begin/end block was found with an empty body.

eko 2020-02-02 11:07

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quartus RTL仿真和门极仿真结果不一样怎么处理

jetlin1992 2020-02-02 11:07

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折腾我的FPGA Arria II GX125做做算法为大家义务做板

为FPGA献身 2020-02-02 11:06

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一位老电子工程师十年的职场感悟(转）

AutoESL 2020-02-02 11:06

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勇敢的芯伴你玩转Altera FPGA连载33：可综合的语法子集4

rousong1989 2020-02-02 11:06

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新手试着写的一个计数器，麻烦大神指点一下

Breakcrow 2020-02-02 11:05

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FPGA单芯片四核二乘二取二的安全系统

kkzz 2020-02-02 11:05

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为大家义务做板用Stratix IV还是KINTEX7 大家来建议吧

为FPGA献身 2020-02-02 11:04

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终于把Cyclone IV E115芯片加了2.54的排针了

为FPGA献身 2020-02-02 11:04

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全局时钟可配置

hnliucan520 2020-02-02 11:04

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